我想知道为什么理想运放会有虚短和虚短的性质,从它的内部电路结构分析。如它的差动输入电路,理想运放的虚断性质是不是就是由它的差动输入端得来的?(因为差动输入的Ri很大所以没有电流流进就是虚断么?)
那虚短呢,为什么会有虚短?也是因为差动输入的构造?
追答虚短跟增益有关系,运放中间级是大增益的级联放大电路,而输出电压由于受到电源电压的限制,不可能无限高,按照Uo=Au*Ui,Uo是一个不太大的值,一般也就是10几20V的样子,Au非常大,可以达到10的4-7次方,因此看起来就相当于输入信号特别小,接近于0,而输入信号就是两个输入端的差值,也就意味着两个输入端信号差值接近于0,就是虚短。这些东西在模电书上都讲得清清楚楚。